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集成電路設(shè)計(jì)中心 企業(yè) 曙海集團(tuán)嵌入式 就業(yè)培訓(xùn)基地長期班 研發(fā)與生產(chǎn)

  
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 　　　　　　　　　　 　 高壓(HV)集成電路ESD/LU防護(hù)設(shè)計(jì)技術(shù)（高階）
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識(shí)：
        ◆電路系統(tǒng)的基本概念。
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       堅(jiān)持小班授課，為保證培訓(xùn)效果，增加互動(dòng)環(huán)節(jié)，每期人數(shù)限3到5人。
   上課時(shí)間和地點(diǎn)
上課地點(diǎn)：【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號(hào)線白銀路站) 【深圳分部】：電影大廈(地鐵一號(hào)線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號(hào)（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
近開課時(shí)間(周末班/連續(xù)班/晚班）： 高壓(HV)集成電路開課時(shí)間：2025年8月18日..用心服務(wù)..........--即將開課--........................(歡迎您垂詢，視教育質(zhì)量為生命！)
   實(shí)驗(yàn)設(shè)備
　    ◆課時(shí)： 一個(gè)月

        
        ☆注重質(zhì)量
        ☆邊講邊練
        ☆合格學(xué)員免費(fèi)推薦工作

        

        專注高端培訓(xùn)17年，曙海提供的課程得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力
        得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。

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   新優(yōu)惠
       ◆在讀學(xué)生憑學(xué)生證，可優(yōu)惠500元。
   質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后免費(fèi)提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。
  　　　　　 高壓(HV)集成電路ESD/LU防護(hù)設(shè)計(jì)技術(shù)（高階）


課程說明及重點(diǎn)

高壓制程電子產(chǎn)品一般大的可靠性問題是靜電放電(ESD) 很差、閂鎖(LU)能力也很差，而且模擬高壓電路輸出端口又會(huì)占很大面積，這會(huì)影響使其ESD能力通常非常不佳。ESD)/LU破壞是影響IC可靠性的重要因素也是延緩產(chǎn)品上市的主因，因此無論由制程上、設(shè)計(jì)上全方位的防護(hù)措施是必要的。本課程是高壓集成IC ESD/LU防護(hù)設(shè)計(jì)上之實(shí)務(wù)課程，更是各高壓集成IC產(chǎn)品ESD可靠度防護(hù)上熱門的技術(shù)。

本課程將從各種HV CMOS元器件、晶圓廠技術(shù)平臺(tái)、HV組件的汲極工程、高壓元器件ESD/LU能力如何測(cè)試介紹起，進(jìn)而談?wù)揌V CMOS 的各電性、可靠度缺點(diǎn)、晶圓廠HV ESD/LU 防護(hù)設(shè)計(jì)法則及各種ESD/LU保護(hù)策略及如何保護(hù)HV LDMOS與HV 集成電路ESD/LU防護(hù)實(shí)際案例分析，后期許學(xué)員能對(duì)HV制程工藝及組件結(jié)構(gòu)充分理解，并熟悉HV IC靜電防護(hù)及LU免疫設(shè)計(jì)之防制意義。

授課對(duì)象

現(xiàn)職從事模擬IC與電子產(chǎn)品之RD設(shè)計(jì)、布局、制造、產(chǎn)品應(yīng)用與品管、品保、FA相關(guān)技術(shù)人員 (對(duì)ESD/LU防護(hù)已有認(rèn)識(shí)者)。

課程大綱


第一階段 :

I. High-Voltage CMOS Devices

◎ What’s an HV Technology ?

◎ How These Products Use the HV Process ?

◎ Foundry Technology Platform

II. Device Engineering for HV Devices

◎ Basic Concepts of an HV IC

◎ Well Engineerings

◎ Electrical Behaviors

III. HV ESD/LU Testing Issues

◎ How to Do an HV IC ESD Testing ?

◎ How to Do an HV IC Latch-up Testing ?

第二階段:

III. Weakness Issues in the HV CMOS Process

◎ High Resistive ESD Element Influence

◎ Intrinsic HV nMOS Reliability Problem

◎ Why ESD Level of the HV-CMOS I/O Protection Circuit is So Bad ?

◎ How About the Occurred Failure Mode in the HV CMOS ?

◎ HV Multi-Finger O/P nMOS Driver Protection Challenge

◎ Impact of Low-Holding-Voltage Issue in HV CMOS Technology

IV HV ESD/LU Rules (ex: 5V/30V/40V)

◎ Foundry HV ESD Design Rules

◎ Foundry HV LU Design Rules

V. Some Strategies of ESD/LU Protection Design in a HV CMOS Process

◎ How to Improve Low Vh ?

◎ How to Adjust Vt1 ?

◎ How to Guarantee That Vt2 >Vt1 ?

◎ How About the Single Finger Width Effect ?

◎ Which One Device Is More Better ?

◎ How About the N-Well Effect in a HV Drain Side ?

Day 3:

VI. How to Protect the HV LDMOS?

◎How to Do a Good ESD Immunity in the HV LDMOS?

◎ESD Protection Methods & Patents for the HV LDMOS

VII. (HV ESD/LU Cases Study)

VIII. Summary
 
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上海總部培訓(xùn)基地

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武漢培訓(xùn)基地

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.(2014年7月11).....直播、現(xiàn)場(chǎng)培訓(xùn)....................................................................................
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